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Detailed Description
22. Configuration Mode Pins
The three jumpers on J17 control the configuration mode pins M0-M2. These pins set the
configuration mode for the FPGA and determine the direction of CCLK (see Table 13 and
Figure 8 ). A jumper across both columns of J17 for each mode pin sets logic 0 ; removing
the jumper sets logic 1 . The default value 000 corresponds to the Master Serial
configuration mode.
Table 13:
Configuration Mode Pin Jumper Settings
Configuration Mode
Master Serial
Master SPI
Master BPI-Up
Master BPI-Down
Master SelectMAP
JTAG
Slave SelectMAP
Slave Serial
M2
0
0
0
0
1
1
1
1
M1
0
0
1
1
0
0
1
1
M0
0
1
0
1
0
1
0
1
CCLK Direction
Output
Output
Output
Output
Output
Input (TCK)
Input
Input
X-Ref Target - Figure 8
J17
(HDR_2x29)
M2
M1
M0
UG222_08_021108
Figure 8:
Default Configuration Mode Jumper Settings
24
www.xilinx.com
Virtex-5 LX FPGA Prototype Platform
UG222 (v1.1.1) March 21, 2011
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